LEVO: A resource flow computer
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Un análisis de la microarquitectura LEVO
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- 1. ARQUITECTURAS ESPECIALIZADAS LEVO Por Orlando Alemán Ortiz
- 35. FIN
Notas del editor
- No se necesitaría cambiar el código ya existente (ya sea para aplicar técnicas de especulación o para adaptarse a la nueva arquitectura.
- Independiente del repertorio de instrucciones Evita recompilar y la aplicación de complicadas técnicas de optimización software El coste de las máquinas existentes crece típicamente con el cuadrado del número de elementos de proceso. Pero aquí no es necesario aumentar el número de buses al aumentar el número de AS
- Las
- Las instrucciones sólo se re-ejecutan si el nuevo valor del operando es distinto del valor actual. Es una predicción basada en el último valor generado
- Ejecutar con los últimos valores supone también una forma de especulación AS son similares a las estaciones de reserva, pero con más funcionalidades. Diferencias: Los Timetags y las direcciones de registro ISA en lugar de renombrar direcciones.
- The path ID value is used when dynamic multipath execution is done The instruction address and predicate information is used as part of the dynamic predication scheme used The additional execution state of an AS consists of information used to guide the AS through operand acquisition, the handling of requested operands by other ASes, determining when execution is possible or when re-executions are needed, and when commitment of this instruction is possible.
- Todos los saltos deben ejecutarse concurrentemente, y las instrucciones después del dominio del salto (instrucciones entre el salto y el destino) deben ejecutarse independientemente del salto Orden O(k), con k el número de instrucciones en la Ventana de Ejecución
- Una entrada en la tabla de saltos tomados significa salto tomado
- Múltiples ISSUES y EXECUTES pueden ocurrir concurrentemente y incluso para una misma instrucción
- El mayor valor de IPC exhibido hasta la fecha está en torno a 7. Corresponde al Superpeculative Engine de Lipasti & Shen
- both research and industry have pursued the "multicore" approach for future processor development due to its rather straightforward complexity (that is: not too much complexity, just put multiple existing cores on a single chip)