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Sigma Delta (ΣΔ) Frequency Synthesizer for DVB-SHRFIC-IUMA
Este documento presenta una tesis doctoral sobre el diseño de un sintetizador de frecuencia basado en Sigma Delta para la aplicación DVB-SH. La tesis describe el diseño de un oscilador controlado por tensión, un divisor rápido, un divisor programable y un modulador Sigma Delta. Incluye simulaciones y mediciones de estos bloques. El objetivo es diseñar un sintetizador fraccional para generar frecuencias en la banda DVB-SH de 2,17 a 2,2 GHz con bajo ruido de fase.
Este documento describe el desarrollo de un simulador DVB-T2 en Simulink. Explica brevemente la historia de la televisión digital y los estándares DVB y DVB-T, y luego se enfoca en describir las características clave de DVB-T2, incluida su estructura física y conceptos básicos. Luego detalla la simulación realizada, incluidos los resultados de constelación, espectro y tasa de error binario obtenidos. Finalmente, concluye resumiendo los fundamentos teóricos cub
Newtec Clean Channel Technology y Nuevas ModulacionesNewtec
PORTUGUESE:
O início desta apresentação contém uma breve introdução sobre a organização DVB e o processo de desenvolvimento de novos padrões. Posteriormente a apresentação elabora as sugestões Newtec para as extensões S2. Uma maior eficiência na transmissão via satélite pode ser obtida através da tecnologia Clean Channel Technology, esquemas de modulação mais eficientes, bem como uma maior granularidade em opções MODCOD .
SPANISH:
Esta presentación comienza con una breve introducción sobre la organización DVB y el proceso de elaboración de nuevas normas. Posteriormente, la presentación elabora las sugerencias de Newtec para las extensiones S2. Una mayor eficiencia en la transmisión por satélite se puede conseguir a través de la tecnología Clean Channel Technology, los esquemas de modulación más eficiente y una mayor granularidad en opciones MODCOD.
ENGLISH:
This presentation starts with a short introduction on the DVB organization and the process of developing new standards. Subsequently the presentation elaborates on the Newtec suggestions for the S2 extensions. Improved efficiency in satellite transmission can be obtained via Clean Channel Technology, more efficient modulation schemes as well as a higher granularity in MODCOD options.
Diseño WiFi y Bluetooth con módulos de comunicaciones WirelessTagMonolitic, S.A.
En esta nota técnica te explicamos las ventajas de trabajar con módulos de comunicaciones en los diseños de aplicaciones de alta frecuencia WiFi o BLE para ahorrar la fase de cálculo, diseño y testeo, y facilitar la programación.
Contacta con nosotros para más información. Te ayudamos a desarrollar tu aplicación: info@monolitic.com
Diseño de un Amplificador Distribuido para UWB Basado en HBT de la Tecnología...RFIC-IUMA
Este documento describe el diseño de un amplificador distribuido para ultra banda ancha basado en la tecnología SiGe 0.35 μm de AMS. El diseño consiste en cuatro etapas con una ganancia de 10 dB y una frecuencia de corte de 11 GHz. Se explican conceptos teóricos como amplificadores distribuidos y el estándar IEEE 802.15.3a, y se detallan los cálculos y componentes necesarios para el diseño a nivel de esquemático y layout usando la tecnología S35D4 de AMS.
Diseño de un Oscilador Controlado por Tensión (VCO) en Tecnología SiGe 0.35µm...RFIC-IUMA
Este documento describe el diseño de un oscilador controlado por tensión (VCO) en tecnología SiGe 0.35 μm para el estándar DVB-H. Se presenta la introducción al estándar DVB-H y sus requisitos, así como la estructura y objetivos del proyecto de diseño del VCO. Se explican también conceptos básicos sobre osciladores como su funcionamiento, clasificación y tipos de osciladores LC.
El documento proporciona una introducción a los estándares DVB (Digital Video Broadcasting) para la transmisión digital de televisión, incluyendo DVB-T, DVB-T2, DVB-H, DVB-SH, DVB-S, DVB-S2, DVB-C y DVB-C2. Explica las características clave y aplicaciones de cada estándar, así como su implementación en el mercado.
Diseño de un Sintetizador para el Estándar IEEE 802.11aRFIC-IUMA
Este documento describe el diseño de un sintetizador de frecuencias para el estándar IEEE 802.11a para redes inalámbricas. El autor analiza el estándar, los sistemas de radiofrecuencia, los tipos de receptores y los componentes de un sintetizador. Luego describe el diseño detallado de cada componente del sintetizador y concluye evaluando el presupuesto del proyecto.
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O início desta apresentação contém uma breve introdução sobre a organização DVB e o processo de desenvolvimento de novos padrões. Posteriormente a apresentação elabora as sugestões Newtec para as extensões S2. Uma maior eficiência na transmissão via satélite pode ser obtida através da tecnologia Clean Channel Technology, esquemas de modulação mais eficientes, bem como uma maior granularidade em opções MODCOD .
SPANISH:
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ENGLISH:
This presentation starts with a short introduction on the DVB organization and the process of developing new standards. Subsequently the presentation elaborates on the Newtec suggestions for the S2 extensions. Improved efficiency in satellite transmission can be obtained via Clean Channel Technology, more efficient modulation schemes as well as a higher granularity in MODCOD options.
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Este documento describe el Método IQMC para construir modelos de calidad de software. El método consiste en 6 pasos iterativos: 1) análisis del dominio, 2) refinamiento del modelo, 3) definición de atributos, 4) descomposición de atributos, 5) definición de relaciones, y 6) definición de métricas. Se proveen ejemplos de modelos conceptuales, jerarquías de características y atributos, y definiciones formales de métricas. Adicionalmente, se discute la inclusión de at
Ficha 4 diseño y cálculo de un transformadorEneko Lamarain
El documento describe un proyecto para diseñar, construir y probar un transformador eléctrico. Se especifica que el transformador debe elevar la tensión de entrada de 230V a una tensión de salida de 27V con una potencia de 324VA. El proyecto incluye calcular las especificaciones del transformador, construir el núcleo, bobinar el transformador, y realizar pruebas de vacío y cortocircuito para verificar su funcionamiento.
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Este documento evalúa las prestaciones de un sistema OFDM sobre la red eléctrica de un vehículo de acuerdo con el nuevo estándar G.hn. Se modela el canal como un filtro lineal e invariante en el tiempo con ruido estacionario y colorido. El sistema OFDM usa pulse shaping en transmisión y windowing en recepción para mejorar el confinamiento espectral y reducir la interferencia entre portadoras. Los resultados muestran tasas binarias superiores a 315 Mbps en el 50% de los canales y ganancias adicionales del 2
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Este documento describe los estándares y formatos clave para HDTV, incluyendo ATSC, DVB, SMPTE y otros. También cubre codificación de video y audio, equipos de monitoreo, y métodos para asegurar la calidad de señales HDTV.
Presentación del Trabajo Fin de Grado de Guillermo Ojeda, titulado Diseño de un Amplificador Integrado en configuración Doherty en tecnología GaN. Defendido el mes de julio de 2017 con mención en matrícula de honor.
Presentación del Trabajo Fin de Grado de Guillermo Ojeda, titulado Diseño de un Cabezal de Recepción para el estándar IEEE 802.15.4 en tecnología CMOS de 65 nm. Defendido el mes de julio de 2017 con mención en matrícula de honor.
Diseño de un Amplificador de Ganancia Programable para un Receptor IEEE 802.1...RFIC-IUMA
Este documento describe el diseño de un amplificador de ganancia programable para un receptor IEEE 802.15.4 usando tecnología CMOS 0.18 μm. Se diseñó un amplificador operacional, una resistencia variable y un varactor para cumplir con especificaciones de bajo consumo, alta linealidad y ancho de banda constante. Se simuló el amplificador, el receptor completo y se compararon los resultados con otros diseños, mostrando un consumo de potencia menor de 6.24 mW y una ganancia de 87 dB.
Diseño de un receptor de wake-up para WSN basado en la arquitectura Uncertain-IFRFIC-IUMA
Este documento presenta el diseño a nivel de layout de los componentes clave de un receptor de "wake-up" para redes de sensores inalámbricas basado en la arquitectura "Uncertain-IF". Se describe el diseño del layout del mezclador, detector de envolvente diferencial y etapa amplificadora, así como su simulación. El objetivo es realizar el diseño a nivel de layout del esquemático obtenido en un trabajo de fin de máster previo para optimizar la sensibilidad, consumo y alcance del receptor manteniendo un b
Implementación física y verificación de un cabezal de recepción para el están...RFIC-IUMA
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Diseño de un transmisor para el estándar IEEE 802.15.4 en tecnología CMOS 0.1...RFIC-IUMA
Este documento describe el diseño de un transmisor para el estándar IEEE 802.15.4 en tecnología CMOS 0.18 μm. Se presentan los objetivos de bajo consumo y área reducida. Se describe el diseño de un mezclador pasivo doblemente balanceado y de un amplificador de potencia de dos etapas de clase A. Finalmente, se muestran los resultados de simulación del mezclador y del amplificador de potencia.
Diseño de un filtro polifásico para un receptor IEEE 802.15.4 en tecnología...RFIC-IUMA
Este documento describe el diseño de un filtro polifásico para un receptor IEEE 802.15.4 en tecnología CMOS 0.18 μm. El objetivo principal es diseñar un filtro polifásico de bajo consumo para eliminar las frecuencias imagen en la banda de 2.4 GHz. El documento comienza explicando la teoría básica de los filtros y luego describe el diseño de un filtro paso bajo pasivo, un filtro activo basado en la topología Gm-C y la teoría de los filtros polifásicos. Finalmente
Sistema de localización de objetos basado en tecnología de Código Abierto de ...RFIC-IUMA
Este documento describe el diseño y desarrollo de un sistema de localización de objetos basado en la tecnología Arduino. El sistema utiliza una placa Arduino Uno, un módulo GPRS y un módulo GPS para determinar la ubicación de un objeto y enviar un SMS si se aleja de una ubicación de referencia. El documento explica el estudio de la tecnología Arduino, el diseño del localizador, la programación de sus funciones y las pruebas realizadas para verificar su funcionamiento.
Diseño de un circuito Wake-up para redes de sensores inalámbricasRFIC-IUMA
Este documento describe el diseño de un circuito wake-up para redes de sensores inalámbricas. Se implementó un circuito wake-up pasivo usando diodos rectificadores y un filtro RC para generar la señal de activación. También se diseñó el circuito en una PCB y se implementó un módulo digital usando un microcontrolador MSP430 y un receptor AS3933. Las mediciones mostraron que el circuito wake-up puede despertar sensores a distancias de hasta 40 metros con un consumo de solo 3 μA en modo dormido.
Caracterización del equipo de prácticas ME1000 para el diseño de circuitos de RFRFIC-IUMA
El documento describe el equipo de prácticas ME1000 y sus subsistemas. Se divide en cuatro bloques: introducción, subsistemas del equipo, transceptor RF completo y valoración del proyecto. En la introducción se describen los objetivos de formación y aplicados al equipo. Los subsistemas analizados incluyen el amplificador de potencia, amplificador de bajo ruido y otros. En el bloque de transceptor RF completo se analizan las cabeceras de RF y el modelo comportamental del sistema. El último bloque contiene las conclusiones y presupuesto.
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Sistema de estabilización de cámara para cartografía aéreaRFIC-IUMA
Este documento describe el diseño de un sistema de estabilización de cámara para cartografía aérea. El sistema utiliza sensores inerciales, actuadores lineales y un microcontrolador para corregir los ángulos de cabeceo, alabeo y guiñada de una cámara durante la toma de fotografías aéreas. El documento también cubre el diseño de hardware, software y estructura necesarios para el sistema de estabilización.
Control automático de un sistema de riegoRFIC-IUMA
Este documento describe el diseño e implementación de un sistema de riego automático controlado. Se utilizarán placas Arduino, módulos XBee para comunicación inalámbrica entre nodos, y un módulo GPRS para control remoto. El sistema constará de 4 zonas de riego con sensores de humedad, iluminación, nivel de agua y batería. El controlador automatizará el riego basado en los datos de los sensores de forma autónoma y permitirá el monitoreo y control remoto a través de GPRS.
Diseño de un LNA basado en convertidores de corriente utilizando técnicas de ...RFIC-IUMA
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Comunicaciones a través de voz sobre IP. Casos prácticos, adaptación empresar...RFIC-IUMA
Este documento presenta un resumen de un proyecto de investigación sobre la voz sobre IP (VoIP). El proyecto analiza el estado actual de las redes de nueva generación, la telefonía tradicional frente a la VoIP, los dispositivos y software necesarios para VoIP, casos prácticos de implantación de VoIP y conclusiones. El documento está estructurado en 7 capítulos que cubren la introducción, el estado de las redes, telefonía tradicional vs VoIP, dispositivos VoIP, casos prácticos, conclusiones y presupuesto.
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Diseño de un modulador Sigma-Delta en Tiempo Continuo para un PLL N-Fraccional en Tecnología UMC 90nm
1. Diseño de un modulador Sigma-Delta en
Tiempo Continuo para un PLL N-Fraccional en
Tecnología UMC 90nm
Autor: Enara Ortega García Tutor: Francisco Javier del Pino Suárez
EITE Ingeniería Electrónica Cotutor: Jesús Rubén Pulido Medina
ULPGC Noviembre de 2012
Proyecto Fin de Carrera
1
2. • Estructura del Proyecto
Introducción
Estándar DVB-SH
Bloque 1
Sintetizadores de frecuencia
Objetivos
Introducción a la modulación Sigma-Delta
Bloque 2 Moduladores Sigma-Delta en Tiempo Continuo
Metodología de diseño
Diseño de los bloques que componen el modulador
Metodología gm/ID
Diseño del OTA
Bloque 3
Diseño del comparador
Simulación del modulador Sigma-Delta
Solución de los problemas de estabilidad
Conclusiones
Bloque 4
Presupuesto
2
3. • Estructura del Proyecto
Introducción
Estándar DVB-SH
Bloque 1
Sintetizadores de frecuencia
Objetivos
Introducción a la modulación Sigma-Delta
Bloque 2 Moduladores Sigma-Delta en Tiempo Continuo
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Diseño de los bloques que componen el modulador
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Bloque 3
Diseño del comparador
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Solución de los problemas de estabilidad
Conclusiones
Bloque 4
Presupuesto
3
4. • Estructura del Proyecto
Introducción
Estándar DVB-SH
Bloque 1
Sintetizadores de frecuencia
Objetivos
Introducción a la modulación Sigma-Delta
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Diseño de los bloques que componen el modulador
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Bloque 3
Diseño del comparador
Simulación del modulador Sigma-Delta
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Bloque 4
Presupuesto
4
6. • Estructura del Proyecto
Introducción
Estándar DVB-SH
Bloque 1
Sintetizadores de frecuencia
Objetivos
Introducción a la modulación Sigma-Delta
Bloque 2 Moduladores Sigma-Delta en Tiempo Continuo
Metodología de diseño
Diseño de los bloques que componen el modulador
Metodología gm/ID
Diseño del OTA
Bloque 3
Diseño del comparador
Simulación del modulador Sigma-Delta
Solución de los problemas de estabilidad
Conclusiones
Bloque 4
Presupuesto
6
9. Estándar DVB-SH
DIVISIÓN DE CANALES
ANCHO DE BANDA NÚMERO DE CANALES
1,7 MHz 30/1,7= 17,65
5 MHz 30/5=6
6 MHz 30/6=5
7 MHz 30/7=4,28
8 MHz 30/8=5
9
10. • Estructura del Proyecto
Introducción
Estándar DVB-SH
Bloque 1
Sintetizadores de frecuencia
Objetivos
Introducción a la modulación Sigma-Delta
Bloque 2 Moduladores Sigma-Delta en Tiempo Continuo
Metodología de diseño
Diseño de los bloques que componen el modulador
Metodología gm/ID
Diseño del OTA
Bloque 3
Diseño del comparador
Simulación del modulador Sigma-Delta
Solución de los problemas de estabilidad
Conclusiones
Bloque 4
Presupuesto
10
12. • Estructura del Proyecto
Introducción
Estándar DVB-SH
Bloque 1
Sintetizadores de frecuencia
Objetivos
Introducción a la modulación Sigma-Delta
Bloque 2 Moduladores Sigma-Delta en Tiempo Continuo
Metodología de diseño
Diseño de los bloques que componen el modulador
Metodología gm/ID
Diseño del OTA
Bloque 3
Diseño del comparador
Simulación del modulador Sigma-Delta
Solución de los problemas de estabilidad
Conclusiones
Bloque 4
Presupuesto
12
13. Objetivos
• Diseño de un modulador Sigma-Delta para ser
empleado en un sintetizador de frecuencia para DVB-SH
• Dicho modulador deberá ser capaz de trabajar con
una frecuencia de muestreo de 40MHz.
MODULADOR SIGMA-DELTA EN
TIEMPO CONTINUO
• Realización de dicho modulador en la tecnología 90nm
de UMC
13
14. • Estructura del Proyecto
Introducción
Estándar DVB-SH
Bloque 1
Sintetizadores de frecuencia
Objetivos
Introducción a la modulación Sigma-Delta
Bloque 2 Moduladores Sigma-Delta en Tiempo Continuo
Metodología de diseño
Diseño de los bloques que componen el modulador
Metodología gm/ID
Diseño del OTA
Bloque 3
Diseño del comparador
Simulación del modulador Sigma-Delta
Solución de los problemas de estabilidad
Conclusiones
Bloque 4
Presupuesto
14
15. • Estructura del Proyecto
Introducción
Estándar DVB-SH
Bloque 1
Sintetizadores de frecuencia
Objetivos
Introducción a la modulación Sigma-Delta
Bloque 2 Moduladores Sigma-Delta en Tiempo Continuo
Metodología de diseño
Diseño de los bloques que componen el modulador
Metodología gm/ID
Diseño del OTA
Bloque 3
Diseño del comparador
Simulación del modulador Sigma-Delta
Solución de los problemas de estabilidad
Conclusiones
Bloque 4
Presupuesto
15
16. Introducción a la modulación Sigma-Delta
Modulador Sigma-Delta de
Primer Orden
• Sobremuestreo
• Conformado espectral del ruido de cuantificación
16
17. Introducción a la modulación Sigma-Delta
•Sobremuestreo ¡¡ Disminución del
ruido de
cuantificación !!
•Conformado espectral del ruido
17
18. Introducción a la modulación Sigma-Delta
Modulador Sigma-Delta lineal
Retardo de la Filtro Paso Alto
señal
18
20. • Estructura del Proyecto
Introducción
Estándar DVB-SH
Bloque 1
Sintetizadores de frecuencia
Objetivos
Introducción a la modulación Sigma-Delta
Bloque 2 Moduladores Sigma-Delta en Tiempo Continuo
Metodología de diseño
Diseño de los bloques que componen el modulador
Metodología gm/ID
Diseño del OTA
Bloque 3
Diseño del comparador
Simulación del modulador Sigma-Delta
Solución de los problemas de estabilidad
Conclusiones
Bloque 4
Presupuesto
20
21. Modulador Sigma-Delta en Tiempo Discreto
H (z) 1
Y (z) U (z) E ( z ) STF ( z )U ( z ) NTF ( z ) E ( z )
1 H (z) 1 H (z)
FUNCIÓN DE TRANSFERENCIA FUNCIÓN DE TRANSFERENCIA
PARA LA SEÑAL PARA EL RUIDO
21
22. Modulador Sigma-Delta en Tiempo Continuo
Implementación del filtro con
circuitos en tiempo continuo:
• Circuitos LC • Aumentar la frecuencia
de muestreo
• Integradores gm-C
• Integradores basados en
Amplificadores Operacionales
22
23. ΣΔ en Tiempo Continuo vs. ΣΔ en Tiempo Discreto
SIGMA DELTA EN TIEMPO CONTINUO
VENTAJAS:
• Aumento de la frecuencia de muestreo
• Eliminación de glitches
• No necesitan filtro antialiasing
DESVENTAJAS
• Mayor influencia de jitter de la señal de reloj
• Problema del retardo de bucle en exceso (ELD)
23
24. • Estructura del Proyecto
Introducción
Estándar DVB-SH
Bloque 1
Sintetizadores de frecuencia
Objetivos
Introducción a la modulación Sigma-Delta
Bloque 2 Moduladores Sigma-Delta en Tiempo Continuo
Metodología de diseño
Diseño de los bloques que componen el modulador
Metodología gm/ID
Diseño del OTA
Bloque 3
Diseño del comparador
Simulación del modulador Sigma-Delta
Solución de los problemas de estabilidad
Conclusiones
Bloque 4
Presupuesto
24
26. Diseño de un modulador ΣΔ en Tiempo Continuo
DISEÑO TOTALMENTE EN EL DOMINIO ANALÓGICO
DISEÑO BASADO EN LA RESPUESTA INVARIANTE AL IMPULSO
26
27. Diseño totalmente en el Dominio Analógico
ADS, DESIGN
FILTER
Fp=20KHz
Fs=35KHz
Frecuencia de la señal de
entrada = 2’3KHz
27
28. Diseño totalmente en el Dominio Analógico
PROBLEMAS
• Tiempo de simulación muy
elevado
No podemos hacer un
•
estudio óptimo del sistema
28
29. Respuesta Invariante al impulso
MODULADORΣΔ EN TIEMPO CONTINUO MODULADORΣΔ EN TIEMPO DISCRETO
29
30. Respuesta Invariante al impulso
Pasos a seguir
• Diseñar NTF(z)
• Calcular H(z)
• Seleccionar el tipo de pulso del DAC y calcular H(s)
• Seleccionar una arquitectura
• Simular
30
31. Arquitecturas de Implementación
• CIFB (Integradores en cascada con realimentaciones)
• CIFF (Integradores en cascada con prealimentaciones)
• CRFB (Resonadores en cascada con realimentaciones)
• CRFF (Resonadores en cascada con prealimentaciones)
31
32. Arquitecturas de Implementación
• CIFB (Integradores en cascada con realimentaciones)
• CIFF (Integradores en cascada con prealimentaciones)
• CRFB (Resonadores en cascada con realimentaciones)
• CRFF (Resonadores en cascada con prealimentaciones)
32
33. Arquitecturas de Implementación
• CIFB (Integradores en cascada con realimentaciones)
• CIFF (Integradores en cascada con prealimentaciones)
• CRFB (Resonadores en cascada con realimentaciones)
• CRFF (Resonadores en cascada con prealimentaciones)
33
34. Arquitecturas de Implementación
• CIFB (Integradores en cascada con realimentaciones)
• CIFF (Integradores en cascada con prealimentaciones)
• CRFB (Resonadores en cascada con realimentaciones)
• CRFF (Resonadores en cascada con prealimentaciones)
34
35. Arquitecturas de Implementación
• CIFB (Integradores en cascada con realimentaciones)
• CIFF (Integradores en cascada con prealimentaciones)
• CRFB (Resonadores en cascada con realimentaciones)
• CRFF (Resonadores en cascada con prealimentaciones)
35
36. Ejemplo
Cálculo de la NTF: synthesizeNTF
Ancho de Relación de Orden Frecuencia de
Banda (BW) sobremuestreo (OSR) muestreo (Fs)
100 KHz 100 4 20MHz
36
40. • Estructura del Proyecto
Introducción
Estándar DVB-SH
Bloque 1
Sintetizadores de frecuencia
Objetivos
Introducción a la modulación Sigma-Delta
Bloque 2 Moduladores Sigma-Delta en Tiempo Continuo
Metodología de diseño
Diseño de los bloques que componen el modulador
Metodología gm/ID
Diseño del OTA
Bloque 3
Diseño del comparador
Simulación del modulador Sigma-Delta
Solución de los problemas de estabilidad
Conclusiones
Bloque 4
Presupuesto
40
41. • Estructura del Proyecto
Introducción
Estándar DVB-SH
Bloque 1
Sintetizadores de frecuencia
Objetivos
Introducción a la modulación Sigma-Delta
Bloque 2 Moduladores Sigma-Delta en Tiempo Continuo
Metodología de diseño
Diseño de los bloques que componen el modulador
Metodología gm/ID
Diseño del OTA
Bloque 3
Diseño del comparador
Simulación del modulador Sigma-Delta
Solución de los problemas de estabilidad
Conclusiones
Bloque 4
Presupuesto
41
42. Diseño de los bloques que componen un modulador ΣΔ
42
43. Diseño de los bloques que componen un modulador ΣΔ
43
44. Diseño de los bloques que componen un modulador ΣΔ
44
45. Diseño de los bloques que componen un modulador ΣΔ
45
46. Diseño de los bloques que componen un modulador ΣΔ
Filtro biquad
46
47. Diseño de los bloques que componen un modulador ΣΔ
47
48. • Estructura del Proyecto
Introducción
Estándar DVB-SH
Bloque 1
Sintetizadores de frecuencia
Objetivos
Introducción a la modulación Sigma-Delta
Bloque 2 Moduladores Sigma-Delta en Tiempo Continuo
Metodología de diseño
Diseño de los bloques que componen el modulador
Metodología gm/ID
Diseño del OTA
Bloque 3
Diseño del comparador
Simulación del modulador Sigma-Delta
Solución de los problemas de estabilidad
Conclusiones
Bloque 4
Presupuesto
48
49. Metodología gm/ID
• Reducción de las dimensiones de los transistores
Disminución de las tensiones de alimentación
• Desarrollo de metodologías basadas modelos de
transistores que modelen todos sus regiones de
operación: EKV, BSIM, …
• Metodología gm/ID ofrece un método sencillo para el
cálculo de las dimensiones de los transistores.
49
53. Metodología gm/ID
• Explota la relación entre la transconductancia y la corriente
de drenador (gm/ID)
• Tanto la transconductancia como la corriente de drenador
varían con el ancho de puerta y, por lo tanto, la relación gm/ID
no dependerá del mismo
• Además, la corriente normalizada ID/(W/L) también es
independiente del tamaño del mismo
53
54. Metodología gm/ID
• Conociendo la relación gm/ID de un transistor cuya longitud y ancho
de puerta son conocidos podremos calcular la corriente de drenador:
*
gm g gm
I m ID
*
D ID gm
I
D
• Conociendo la corriente de drenador podemos calcular la relación
W/L:
ID I D
*
W W ID
*
W W *
L L L L I D *
54
57. • Estructura del Proyecto
Introducción
Estándar DVB-SH
Bloque 1
Sintetizadores de frecuencia
Objetivos
Introducción a la modulación Sigma-Delta
Bloque 2 Moduladores Sigma-Delta en Tiempo Continuo
Metodología de diseño
Diseño de los bloques que componen el modulador
Metodología gm/ID
Diseño del OTA
Bloque 3
Diseño del comparador
Simulación del modulador Sigma-Delta
Solución de los problemas de estabilidad
Conclusiones
Bloque 4
Presupuesto
57
61. • Estructura del Proyecto
Introducción
Estándar DVB-SH
Bloque 1
Sintetizadores de frecuencia
Objetivos
Introducción a la modulación Sigma-Delta
Bloque 2 Moduladores Sigma-Delta en Tiempo Continuo
Metodología de diseño
Diseño de los bloques que componen el modulador
Metodología gm/ID
Diseño del OTA
Bloque 3
Diseño del comparador
Simulación del modulador Sigma-Delta
Solución de los problemas de estabilidad
Conclusiones
Bloque 4
Presupuesto
61
65. Diseño del Comparador
Latch-Comparator
• Fase de Reset (CLk=0)
• M5 apagado
• M7, M3, M4 Y M6 resetean los
nodos de salida a VDD.
• Fase de Set (CLk=1)
• Una salida estará a VDD y la
otra a 0 según la tensión del par
diferencial de entrada
65
70. • Estructura del Proyecto
Introducción
Estándar DVB-SH
Bloque 1
Sintetizadores de frecuencia
Objetivos
Introducción a la modulación Sigma-Delta
Bloque 2 Moduladores Sigma-Delta en Tiempo Continuo
Metodología de diseño
Diseño de los bloques que componen el modulador
Metodología gm/ID
Diseño del OTA
Bloque 3
Diseño del comparador
Simulación del modulador Sigma-Delta
Solución de los problemas de estabilidad
Conclusiones
Bloque 4
Presupuesto
70
71. Simulación de los moduladores ΣΔ
INTEGRADORES FILTRO BIQUAD
SNR=18dB SNR=21dB
Potencia disipada=1,84mW Potencia disipada=636uW
71
74. • Estructura del Proyecto
Introducción
Estándar DVB-SH
Bloque 1
Sintetizadores de frecuencia
Objetivos
Introducción a la modulación Sigma-Delta
Bloque 2 Moduladores Sigma-Delta en Tiempo Continuo
Metodología de diseño
Diseño de los bloques que componen el modulador
Metodología gm/ID
Diseño del OTA
Bloque 3
Diseño del comparador
Simulación del modulador Sigma-Delta
Solución de los problemas de estabilidad
Conclusiones
Bloque 4
Presupuesto
74
75. Problemas de estabilidad
INTEGRADORES IDEALES
40
20
0 Pero en la realidad no tenemos
-20
integradores ideales, éstos
tendrán un rango de entrada y
Magnitud(dB)
-40
una excursión de salida
-60 limitados
-80
-100 SNR=74.806943
-120
2 3 4 5 6 7
10 10 10 10 10 10
Frecuencia 75
76. Problemas de estabilidad
INTEGRADORES LIMITADOS
40
20
0
-20 Tenemos los mismos armónicos
-40 que en las simulaciones a nivel
Magnitud(dB)
-60
de circuitos
-80
-100 SNR=18.222663
-120
-140
-160
2 3 4 5 6 7
10 10 10 10 10 10
Frecuencia 76
77. Escalado de los coeficientes
• El método seguido para calcular los coeficientes, fija todas las ganancias de
los integradores a 1 y no tiene en cuenta el nivel de la señal de salida de cada
integrador.
• Debemos emplear un método de escalado de estos coeficientes de forma que
no saturemos los circuitos de nuestro modulador y, además, preservemos la
NTF.
77
78. Escalado de los coeficientes
40
20
0
-20
Magnitud(dB)
-40
-60
-80
-100 SNR=74.039849
-120 2 3 4 5 6 7
10 10 10 10 10 10
Frecuencia
Comprobamos el resultado de escalar los coeficientes en el modulador
diseñado a nivel de circuitos
78
79. Escalado de los coeficientes
Los armónicos
prácticamente han
desaparecido
SNR=42dB
79
80. • Estructura del Proyecto
Introducción
Estándar DVB-SH
Bloque 1
Sintetizadores de frecuencia
Objetivos
Introducción a la modulación Sigma-Delta
Bloque 2 Moduladores Sigma-Delta en Tiempo Continuo
Metodología de diseño
Diseño de los bloques que componen el modulador
Metodología gm/ID
Diseño del OTA
Bloque 3
Diseño del comparador
Simulación del modulador Sigma-Delta
Solución de los problemas de estabilidad
Conclusiones
Bloque 4
Presupuesto
80
81. • Estructura del Proyecto
Introducción
Estándar DVB-SH
Bloque 1
Sintetizadores de frecuencia
Objetivos
Introducción a la modulación Sigma-Delta
Bloque 2 Moduladores Sigma-Delta en Tiempo Continuo
Metodología de diseño
Diseño de los bloques que componen el modulador
Metodología gm/ID
Diseño del OTA
Bloque 3
Diseño del comparador
Simulación del modulador Sigma-Delta
Solución de los problemas de estabilidad
Conclusiones
Bloque 4
Presupuesto
81
82. Conclusiones
• Se ha diseñado un modulador de orden 2 que cumple con las
especificaciones pedidas para ser empleado en un sintetizador
de frecuencia para el estándar DVB-SH.
• Para el diseño de los circuitos que componen el mismo se ha
seguido una metodología que nos permitirá conseguir unas
buenas prestaciones con un bajo consumo.
• Además, nos hemos dado cuenta del problema de estabilidad
de los moduladores en cuanto a la saturación de los circuitos
que implementan el mismo. Y, hemos estudiado una
metodología para su solución.
82
83. Trabajos futuros
• Como líneas futuras de este proyecto, se podría integrar el
modulador diseñado en el sintetizador de frecuencias para
comprobar su funcionamiento.
• Podría llevarse a cabo moduladores con prestaciones más
altas para poder ser empleados en circuitos con unas
restricciones más exigentes. Como puede ser, pasar a circuito
el modulador diseñado a nivel de bloques de orden 4, el cual
posee prealimentaciones y consumirá menos que si el mismo
fuera realizado con realimentaciones.
• Además, podría estudiarse el problema de retardo de bucle
en exceso (ELD) e intentar compensarlo para, de esta forma,
elevar la SNR.
83
84. • Estructura del Proyecto
Introducción
Estándar DVB-SH
Bloque 1
Sintetizadores de frecuencia
Objetivos
Introducción a la modulación Sigma-Delta
Bloque 2 Moduladores Sigma-Delta en Tiempo Continuo
Metodología de diseño
Diseño de los bloques que componen el modulador
Metodología gm/ID
Diseño del OTA
Bloque 3
Diseño del comparador
Simulación del modulador Sigma-Delta
Solución de los problemas de estabilidad
Conclusiones
Bloque 4
Presupuesto
84
86. Diseño de un modulador Sigma-Delta en
Tiempo Continuo para un PLL N-Fraccional en
Tecnología UMC 90nm
Autor: Enara Ortega García Tutor: Francisco Javier del Pino Suárez
EITE Ingeniería Electrónica Cotutor: Jesús Rubén Pulido Medina
ULPGC Noviembre de 2012
Proyecto Fin de Carrera
86