El documento presenta un examen propuesto para el curso Sistemas Digitales II. Incluye preguntas sobre el mapeo de componentes en un diagrama VHDL, el diseño de una máquina secuencial asíncrona que funcione como un flip-flop tipo T y la implementación de un circuito completo.
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Tema 3 (15P):
Diseñar un Maquina Secuencial Asíncrona (MSA) que hace el trabajo de un
decodificador de entradas (CLK, T) y salidas (X, N). Este decodificador al trabajar en
conjunto con una celda Binaria hace la función de un Flip-Flop tipo T (Inversor).
Diagrama del Flip-Flop tipo T:
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Tablas de funcionamiento:
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NOTA: la asignación de códigos de estado reducido deberá tener distancia unitaria.
PRESENTAR:
a) Diagrama y mapa de estados primitivo (2p).
b) Tabla de Implicantes y diagrama de equivalencia máxima (2p).
c) Diagrama de estados reducido y asignación de código de estados (4p).
d) Mapa de excitación (2p).
e) Expresiones booleanas del decodificador de estado siguiente y salida (1p).
f) Implementar el circuito completo (4p).
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