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TEMA 4DISEÑO LÓGICO SECUENCIAL Prof. Luis Zurita
METODOLOGÍA DE EVALUACIÓN Examen tipo proyecto, incluye simulación en programas como livewire o proteus(25%) más desarrollo del diseño (75%). Según el plan de evaluación, tiene un peso porcentual del 20 %. Bibliografía recomendada: Thomas Floyd, Fundamentos de Sistemas digitales y Ronald Tocci, Sistemas digitales.
METODOLOGÍA DE DISEÑO PASO 1. DIAGRAMA DE ESTADOS. Consideración especial: MSB / LSB Es importante el orden.
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METODOLOGÍA DE DISEÑO PASO 4. LLENADO DE LOS MK ¿Qué colocamos? R= como conocemos las salidas, necesitamos hallar las ecuaciones de las entradas J y K, por lo tanto se colocan las salidas. J0 K0 Q0 Q0 0 0 1 1 Q2Q1 Q2Q1 0 0 0 0 0 1 0 1 1 1 1 1 Nota: se recomienda llenar simultáneamente el par J, K para la salida correspondiente. 1 0  1 0
METODOLOGÍA DE DISEÑO PASO 4. LLENADO DE LOS MK J0 K0 Q0 Q0 0 0 1 1 Q2Q1 Q2Q1 0 0 0 0 0 1 0 1 1 1 1 1 1 0  1 0
METODOLOGÍA DE DISEÑO PASO 5: ECUACIONES DE ESTADO: 	De los mapas de Karnaugh se extraen las ecuaciones simplificadas. PASO 6: ELABORACIÓN DEL CIRCUITO LÓGICO EQUIVALENTE: 	De las ecuaciones simplificadas se procede a dibujar el circuito correspondiente.

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  • 1. TEMA 4DISEÑO LÓGICO SECUENCIAL Prof. Luis Zurita
  • 2. METODOLOGÍA DE EVALUACIÓN Examen tipo proyecto, incluye simulación en programas como livewire o proteus(25%) más desarrollo del diseño (75%). Según el plan de evaluación, tiene un peso porcentual del 20 %. Bibliografía recomendada: Thomas Floyd, Fundamentos de Sistemas digitales y Ronald Tocci, Sistemas digitales.
  • 3. METODOLOGÍA DE DISEÑO PASO 1. DIAGRAMA DE ESTADOS. Consideración especial: MSB / LSB Es importante el orden.
  • 4. METODOLOGÍA DE DISEÑO PASO 2. TABLA DEL ESTADO SIGUIENTE Y REINICIA
  • 5. METODOLOGÍA DE DISEÑO PASO 3. TABLA DE TRANSICIÓN FF
  • 6. METODOLOGÍA DE DISEÑO PASO 4. LLENADO DE LOS MK ¿Qué colocamos? R= como conocemos las salidas, necesitamos hallar las ecuaciones de las entradas J y K, por lo tanto se colocan las salidas. J0 K0 Q0 Q0 0 0 1 1 Q2Q1 Q2Q1 0 0 0 0 0 1 0 1 1 1 1 1 Nota: se recomienda llenar simultáneamente el par J, K para la salida correspondiente. 1 0 1 0
  • 7. METODOLOGÍA DE DISEÑO PASO 4. LLENADO DE LOS MK J0 K0 Q0 Q0 0 0 1 1 Q2Q1 Q2Q1 0 0 0 0 0 1 0 1 1 1 1 1 1 0 1 0
  • 8. METODOLOGÍA DE DISEÑO PASO 5: ECUACIONES DE ESTADO: De los mapas de Karnaugh se extraen las ecuaciones simplificadas. PASO 6: ELABORACIÓN DEL CIRCUITO LÓGICO EQUIVALENTE: De las ecuaciones simplificadas se procede a dibujar el circuito correspondiente.