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FABIÁN RENÉ CRUZ REYES Ingeniero Electrónico Esp. Tecnologías de la Información Aplicadas a la Educación LOS FLIP - FLOPS
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FLIP-FLOP (S-R) Las entradas S y R de un Flip – Flop se denominan entradas síncronas, dado que los datos de estas entradas se transfieren a la salida del Flip-Flop sólo con el flanco de disparo del pulso de reloj. Cuando S está a nivel ALTO, y R está a nivel BAJO, la salida Q se pone a nivel ALTO con el flanco de disparo del pulso de reloj, pasando el Flip-Flop al estado SET. CLK S R Q Q̃ Símbolo lógico Flip-Flop S-R S R CLK Q ̃Q Comentarios 0 0 X NC NC No cambio 0 1 ↑ 0 1 RESET 1 0 ↑ 1 0 SET 1 1 ↑ 1 1 Condición no válida
FLIP-FLOP TIPO D Un Flip-Flop tipo D resulta muy útil cuando se necesita almacenar un único bit de datos (1 o 0). Si se añade un inversor a un Flip-Flop S-R obtenemos un Flip-Flop tipo D básico. CLK D Q Q̃ a) Con flando de subida   b) Con flanco de bajada Símbolo lógico Flip-Flop Tipo D
FLIP-FLOP J-K Un Flip-Flop J-K es versátil y es uno de los tipos de Flip-Flop más utilizados, el funcionamiento de este Flip-Flop es idéntico al de un S-R en las condiciones de operación SET, RESET y de permanencia en estado NO Cambio. La diferencia está en que el Flip-Flop J-K no tiene condición no válida como ocurre en el S-R . El estado Toggle o de Basculación, lo que hace es tomar la frecuencia del reloj y dividirla en cada pico sucesivo del reloj, primero Q en ALTO y Q̃ en BAJO e inversamente.
CLK J K Q Q̃ Símbolo lógico Flip-Flop J-K Determine la salida Q para el Flip-Flop J-K, depeendiendo de las entradas mostradas. Ejemplo CLK Q K J Note que las salidas cambian con el flanco de subida del reloj.  Solución Set Toggle Set Set
ENTRADAS ASÍNCRONAS DE INICIALIZACIÓN Y BORRADO CLK K J Q PRE CLR En los Flip-Flops que acabamos de ver, también se pueden encontrar con entradas asíncronas, estas son entradas que pueden variar el estado del Flip-Flop independientemente del reloj. Se denominan de inicialización (PRE) y borrado (CLR) ó de activación directa. Un nivel activo en la entrada de inicialización (preset) pone a SET el dispositivo, y un nivel activo en la entrada de borrado (clear) lo pone en estado RESET.  Si queremos que el Flip-Flop funcione síncronamente, debemos desactivar estas entradas colocándolas en un nivel ALTO. Q
Determine la salida Q del Flip-Flop J-K si tenemos las siguientes entradas: Ejemplo CLK K J Q PRE CLR Solución Set Toggle Reset Toggle Set Set Reset Latch CLK K J Q Q PRE CLR
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Los Flip Flops

  • 1. FABIÁN RENÉ CRUZ REYES Ingeniero Electrónico Esp. Tecnologías de la Información Aplicadas a la Educación LOS FLIP - FLOPS
  • 2.
  • 3. FLIP-FLOP (S-R) Las entradas S y R de un Flip – Flop se denominan entradas síncronas, dado que los datos de estas entradas se transfieren a la salida del Flip-Flop sólo con el flanco de disparo del pulso de reloj. Cuando S está a nivel ALTO, y R está a nivel BAJO, la salida Q se pone a nivel ALTO con el flanco de disparo del pulso de reloj, pasando el Flip-Flop al estado SET. CLK S R Q Q̃ Símbolo lógico Flip-Flop S-R S R CLK Q ̃Q Comentarios 0 0 X NC NC No cambio 0 1 ↑ 0 1 RESET 1 0 ↑ 1 0 SET 1 1 ↑ 1 1 Condición no válida
  • 4. FLIP-FLOP TIPO D Un Flip-Flop tipo D resulta muy útil cuando se necesita almacenar un único bit de datos (1 o 0). Si se añade un inversor a un Flip-Flop S-R obtenemos un Flip-Flop tipo D básico. CLK D Q Q̃ a) Con flando de subida b) Con flanco de bajada Símbolo lógico Flip-Flop Tipo D
  • 5. FLIP-FLOP J-K Un Flip-Flop J-K es versátil y es uno de los tipos de Flip-Flop más utilizados, el funcionamiento de este Flip-Flop es idéntico al de un S-R en las condiciones de operación SET, RESET y de permanencia en estado NO Cambio. La diferencia está en que el Flip-Flop J-K no tiene condición no válida como ocurre en el S-R . El estado Toggle o de Basculación, lo que hace es tomar la frecuencia del reloj y dividirla en cada pico sucesivo del reloj, primero Q en ALTO y Q̃ en BAJO e inversamente.
  • 6. CLK J K Q Q̃ Símbolo lógico Flip-Flop J-K Determine la salida Q para el Flip-Flop J-K, depeendiendo de las entradas mostradas. Ejemplo CLK Q K J Note que las salidas cambian con el flanco de subida del reloj. Solución Set Toggle Set Set
  • 7. ENTRADAS ASÍNCRONAS DE INICIALIZACIÓN Y BORRADO CLK K J Q PRE CLR En los Flip-Flops que acabamos de ver, también se pueden encontrar con entradas asíncronas, estas son entradas que pueden variar el estado del Flip-Flop independientemente del reloj. Se denominan de inicialización (PRE) y borrado (CLR) ó de activación directa. Un nivel activo en la entrada de inicialización (preset) pone a SET el dispositivo, y un nivel activo en la entrada de borrado (clear) lo pone en estado RESET. Si queremos que el Flip-Flop funcione síncronamente, debemos desactivar estas entradas colocándolas en un nivel ALTO. Q
  • 8. Determine la salida Q del Flip-Flop J-K si tenemos las siguientes entradas: Ejemplo CLK K J Q PRE CLR Solución Set Toggle Reset Toggle Set Set Reset Latch CLK K J Q Q PRE CLR
  • 9. APLICACIONES Entradas de datos en paralelo Clock Clear Salidas Q 0 Q 1 Q 2 Q 3 HIGH HIGH CLK K J Q A CLK K J f in Q B f out f in f out a) Divisores de frecuencia b) Almacenamiento de datos en paralelo
  • 10.
  • 11.